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（1） LVDS、FPD LINK III聯系與區别
LVDS中文名是(shì)低電壓差分信号，它隻是(shì)一(yī / yì ／yí)個(gè)物理層的(de)規範。在(zài)它的(de)基礎上(shàng)有很多通信層标準，比如：FPD-Link
FPD-Link是(shì)高速數字視頻接口，主要(yào / yāo)用來(lái)傳輸視頻數據。FPD-Link是(shì)第一(yī / yì ／yí)次對LVDS規範的(de)應用，由于(yú)FPD-Link是(shì)第一(yī / yì ／yí)次對LVDS的(de)成功使用，許多顯示工程師LVDS術語來(lái)代替FPD-Link。
FPD LINK III、MIPI、DVP都是(shì)接口名稱。
TI公司結合汽車娛樂信息系統應用環境，開發出(chū)FPD-Link III 串行器/解串器(ds90ub933、ds90ub934)
（2）LVDS、MIPI聯系
MIPI-CSI-2（camera serial interface）協議是(shì)MIPI聯盟協議的(de)子(zǐ)協議，專門針對攝像頭芯片的(de)接口而(ér)設計，應用非常廣泛，具有高速，低功耗的(de)特點。
聯系：LVDS低電壓差分信号是(shì)一(yī / yì ／yí)種高速串行信号傳輸電平，由于(yú)它傳輸速度快，功耗低，抗幹擾能力強，傳輸距離遠，易于(yú)匹配等優點，非常适合在(zài)mipi輸入輸出(chū)端口使用。（這(zhè)是(shì)是(shì)指物理層信号）
協議：
| 名稱 | 解釋 |
| 應用層 | 即是(shì)處理原始圖像數據的(de)各種算法模塊 |
| 組包層 | 負責将數據按照一(yī / yì ／yí)定的(de)次序，切割成8比特數據 |
| 協議層 | 爲(wéi / wèi)新生的(de)數據加上(shàng)包頭包尾，形成符合協議要(yào / yāo)求的(de)數據流 |
| 通道(dào)管理層 | 将生成的(de)數據流按照一(yī / yì ／yí)定的(de)次序和(hé / huò)要(yào / yāo)求，進行讀寫管理，輸出(chū)數據流 |
| PHY層 | 生成MIPI最後的(de)信号波形 |
| 像素數據 | 經過圖像模塊處理過的(de)數據流，或者原始點額圖像數據流 |
| 傳輸數據 | 經過MIPI模塊切割或者加上(shàng)包頭包尾數據 |
| 控制信号 | 模塊間的(de)控制數據流 |
| 發送端 | 包括了(le／liǎo)MIPI數字部分，轉接闆等實現MIPI信源傳輸的(de)部分 |
| 接收端 | 包括了(le／liǎo)轉接闆和(hé / huò)商用接收端模塊，負責解析收到(dào)的(de)MIPI信源 |
（3）MIPI、DVP、LVDS區别（這(zhè)裏的(de)LVDS是(shì)指接口，也(yě)就(jiù)是(shì)指FPD-LINK接口）
| 名稱 | MIPI接口 | DVP接口 |
| 物理特性 | 輸出(chū)一(yī / yì ／yí)堆差分時(shí)鍾線，若幹對差分數據線，四到(dào)六根 | 十一(yī / yì ／yí)到(dào)十五根線 |
| 傳輸速率 | 傳輸速率快，多用于(yú)五百萬像素及以(yǐ)上(shàng)攝像頭 | 五百萬勉強可以(yǐ)使用 |
| 糾錯能力 | 采用了(le／liǎo)ECC和(hé / huò)CRC編碼有一(yī / yì ／yí)定糾錯能力 | 沒有采用任何糾錯編碼 |
| 抗幹擾性 | 采用低壓差分信号，抗幹擾能力強 | 抗幹擾能力一(yī / yì ／yí)般 |
1. LVDS接口隻用于(yú)傳輸視頻數據，MIPI DSI不(bù)僅能夠傳輸視頻數據，還能傳輸控制指令；
2. LVDS接口主要(yào / yāo)是(shì)将RGB TTL信号按照SPWG/JEIDA格式轉換成LVDS信号進行傳輸，MIPI DSI接口則按照特定的(de)握手順序和(hé / huò)指令規則傳輸屏幕控制所需的(de)視頻數據和(hé / huò)控制數據。
| 接口類型 | 信号線 | 極限速率 | 最大(dà)速率 | 抗幹擾能力 | 适用攝像頭像素 | PCB laypuit | |
| MIPI CSI-2 | 串口 CLKP/N、DATAP/N最大(dà)支持4-lane一(yī / yì ／yí)般2-lane可以(yǐ)搞定 | Gbps | 低壓差分信号，産生的(de)幹擾小，抗幹擾能力也(yě)強 | 支持800W以(yǐ)上(shàng) | Ivds接口耦合， 走線必須差分等長 | ||
| DVP | 并口 PCLK、VSYNC、 HSYNCD[0 : 11] 支持8/10/12bit數據 | PCLK極限96M左右 | PCLK最好控制在(zài)72M以(yǐ)下 | 最大(dà)500W | 阻抗要(yào / yāo)求低 | ||
| FPD-Link Ⅲ LVDS | 串口 | 阻抗要(yào / yāo)求高 | |||||
| GMSL | 串口 | Gbps | 阻抗要(yào / yāo)求高 |
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